等待编译结果的结果在干什么

2020-09-11 18:52:58 +08:00
 ZZSZZSZZS

v 站有做 FPGA 的老哥吗,每次编译的时候都要等好久,在这段时间里大家都在干什么呢。吐槽一下 fpga 的这些工具链真的太难用了,工程稍微一大,编译时间就上天,甚至可能等了半个小时之后发现犯了个简单的语法错误。编译开个多线程结果全部线程还是挤在一个核里面跑,而且一个核都跑不满,真一核有难,7 核围观。干硬件的啥时候才有个好用的工具链啊。

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7 条回复
mason961125
2020-09-11 18:54:35 +08:00
Vivado: 你再骂?
ZZSZZSZZS
2020-09-11 18:56:34 +08:00
@mason961125 讲真,我觉得 quartus 速度快多了
across
2020-09-11 19:01:23 +08:00
fuchunliu
2020-09-11 19:04:36 +08:00
楼主可以利用这段时间重写一个编译器🙃
Chry3anthemum
2020-09-11 19:08:29 +08:00
你跑个 vivado 或者 quartus 就等不及了?
哥哥我 design compilier 跑几百万 instance 的的 synthesis 咋办哟?
跑个 formal 比个 3 天过不了怎么办?
我跑后端 route 挂一晚上早晨不出结果怎么办??

少年,不要等,多出几个版本。每个版本多 try 几个不同的优化。

工程大就把接口做好多包几个 module 跑,拆板子分开跑。——你前期就该规划好资源那里会拥塞哪里 rom 不够的,约束写好放在什么位置省的工具给你乱放浪费时间。

“甚至可能等了半个小时之后发现犯了个简单的语法错误”——这我就要批评你了,你娃明知道会有这样为什么修改完了后不做一把 lint ??嗯?你这是明显浪费时间啊。

多核围观就去看 userguide 怎么在编译脚本里分配 core 的,ug 历史有的。
abutter
2020-09-11 19:09:42 +08:00
语法错误的你都不用工具检查语法的?不跑小仿真测试一下自己的修改?
abutter
2020-09-11 19:10:32 +08:00
今天看到新闻,nextpr 要支持 GPU 加速了,等你综合速度快了之后你就恨了。

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